川大201909学期数字电子技术作业（随机题目）

奥鹏网院作业

201909学期数字电子技术
题量： 100  满分： 100 分  创建者：课程管理员  截止时间：2021-03-31 23:59


一.单选题（共70题,70.0分）

1
的最小项为( )。
  A   
  B   
  C   
  D   


2
设计一个4输入的二进制码奇校验电路,需要( )个异或门。
  A  3
  B  2
  C  4
  D  5


3
处理( )的电子电路是数字电路。
  A  时间和幅值上离散的信号
  B  时间和幅值上连续变化的信号
  C  交流电压信号
  D  交流电流信号


4
用触发器设计电路,产生下图所示输出波形。每一个Z1和Z2的周期内,可以等分为( )段时间间隔相等的状态,需要电路有( )个状态来实现。

  A  4,4
  B  2,2
  C  4,2
  D  3,2


5
利用ROM实现四位二进制码到四位格雷码的转换,则该ROM的地址线有( )根,数据线有4根。
  A  4
  B  2
  C  8
  D  10


6
下列四个数中,与十进制数(163)D不相等的是( )。
  A  
(A3)H

  B  
(10100011)B

  C  
(000101100011)8421BCD

  D  
(203)O



7
将256×1位ROM扩展为1024×4位ROM,需要256×1位ROM( )片。
  A  16
  B  4
  C  8
  D  32


8
( )时,“或非”运算的结果是逻辑0。
  A  只要任一输入为1
  B  只有当全部输入是1
  C  当全部输入是0
  D  只要任一输入为0


9
逻辑式 的反函数是( )。
  A   
  B   
  C   
  D   


10
设计同步时序电路时,如果电路的状态数为M,选择触发器的数目为N,则两者的关系为( )。
  A  2N-1N
  B  M≥2N
  C  (N-1)22
  D  M≥N2


11
以下关于锁存器和触发器描述正确的是( )。
  A  锁存器是脉冲电平敏感器件,触发器是脉冲边沿敏感器件
  B  锁存器和触发器都是脉冲电平敏感器件
  C  锁存器和触发器都是脉冲边沿敏感器件
  D  锁存器是脉冲边沿敏感器件,触发器是脉冲电平敏感器件


12
要改变触发器的状态,必须有CP脉冲的配合。( )
  A  正确
  B  错误


13
单稳态触发器的暂稳态时间与输入触发脉冲宽度成正比。( )
  A  正确
  B  错误


14
若译码-驱动器输出有效电平为高电平,则显示器应选用( )。
  A  共阴极显示器
  B  共阳极显示器
  C  都可以
  D  都不可以


15
已知一个数字电路的逻辑功能是计算2位二进制数的平方,其真值表如下,其中输入信号为 X(X1,X0) 输出信号为 Y(Y3 ,Y2 ,Y1,Y0) ,则根据真值表所得到的方程正确的是:( )。

  A  Y1=0
  B  Y2=0
  C  Y3=0
  D  Y0=0


16
逻辑函数 的最简与或式是( )。
  A   
  B  A
  C  AB+C
  D  AB+CD


17
实现两个四位二进制数相乘的组合电路,应有( )个输出函数。
  A  8
  B  9
  C  10
  D  11


18
将十六进制数 (36.D)H 转换成十进制数是( )D 。
  A  54.8125
  B  36.13
  C  54.13
  D  36.8125


19
用四选一数据选择器实现函数Y=,应使( )。
  A  D0=D1=0,D2=D3=1
  B  D0=D2=1,D1=D3=0
  C  D0=D2=0,D1=D3=1
  D  D0=D1=1,D2=D3=0


20
TTL 逻辑门中与CMOS逻辑门的OD门对应的是( )。
  A  OC门
  B  OD门
  C  TG门
  D  TSL门


21
用4选1数据选择器实现逻辑函数 ,A1,A0从地址端S1,S0输入,数据端应输入( )。
  A  D0=D2=0,D1=D3=1
  B  D0=D2=1,D1=D3=0
  C  D0=D1=0,D2=D3=1
  D  D0=D1=1,D2=D3=0


22
方波信号的占空比是( )%。
  A  50
  B  10
  C  90
  D  75


23
门电路具有多个输入端和多个输出端。( )
  A  正确
  B  错误


24
以下表达式中符合逻辑运算法则的是( )。
  A  A+1=1
  B  C·C=C2
  C  A+A=2A
  D  0<1


25
二进制数1001和二进制代码1001都表示十进制数9。( )
  A  正确
  B  错误


26
对典型集成计数器74LVC161,下列说法错误的是( )。
  A  采用异步置数
  B  是4位二进制加计数器
  C  采用异步清零
  D  可以通过级联扩展计数容量


27
16选1的数据选择器,其地址输入端(选择控制端)有( )个。
  A  4个
  B  3个
  C  2个
  D  1个


28
用 n个触发器构成计数器,可得到的最大计数容量为( )。
  A  2n-1
  B  2n-1
  C  2n
  D  n2


29
下列Verilog HDL程序所描述的电路是( )。
module MED(Q, DATA,CLK)
input DATA,CLK;
output Q;
reg Q;
always @ (posedge CLK)
begin
Q<= DATA;
end
endmodule
  A  D触发器
  B  T触发器
  C  T′触发器
  D  计数器


30
如图所示同步时序电路的初始状态为00,以下三个选项中分别是Q0、Q1和输出Z 对应于 的波形图,其中不正确的是( )。

  A   
  B   
  C   


31
以下电路中常用于总线应用的有( )。
  A  OC门
  B  TSL门
  C  漏极开路门
  D  CMOS与非门


32
555定时器不可以组成( )。
  A  JK触发器
  B  单稳态触发器
  C  施密特触发器
  D  多谐振荡器


33
74290集成计数器芯片的初始状态为Q3Q2Q1Q0=1001,经过6个CP脉冲后,计数器的状态为( )。
  A  0000
  B  0011
  C  0100
  D  0101


34
两个状态等价的条件是在相同的输入条件下具有相同的输出和相同的次态。( )
  A  正确
  B  错误


35
FPGA是指( )。
  A  现场可编程门阵列
  B  可编程逻辑阵列
  C  只读存储器
  D  随机读取存储器


36
关于555定时器的阈值电压说法正确的是( )。
  A  不加控制电压 时,默认是 和  
  B  可以通过加控制电压 改变成 和  
  C  固定不变
  D  不加控制电压 时,默认是 和  


37
在下图所示电路中,不能构成T 触发器逻辑功能的电路是( )。
  A   
  B   
  C   
  D   


38
用3/8线译码器74HC138构成6/64线译码器时,需要( )片74HC138。
  A  9
  B  7
  C  8
  D  10


39
图(a)、图(b)两个逻辑符号( )。

  A  图(a)是D触发器,图(b)是D锁存器
  B  图(a)是D锁存器,图(b)是D触发器
  C  表示的电路工作情况完全相同
  D  表示的电路逻辑功能不同


40
4位移位寄存器,现态 Q0Q1Q2Q3 为1100,经左移1位后其次态 Q0Q1Q2Q3 为( )。
  A  1000或1001
  B  0110或1110
  C  0011或1011
  D  0011或1111


41
将一个时间上连续变化的模拟量转换为时间上断续(离散)的模拟量的过程称为( )。
  A  取样
  B  保持
  C  量化
  D  编码


42
用两片4位比较器74HC85串联接成8位数值比较器时,低位片中的IA、IA=B、IA>B所接的电平应为( )。
  A  010
  B  110
  C  100
  D  111


43
对下图所示电路的描述,错误的是( )。

  A  电路不能自启动
  B  电路是异步时序逻辑电路
  C  电路是加计数器
  D  电路构成的是模16的计数器


44
下面几种A/D转换器中,工作速度最高的是( )。
  A  并行比较型ADC
  B  逐次比较型ADC
  C  双积分型ADC
  D  间接型ADC


45
JK触发器只要J,K端同时为1,则一定引起状态翻转。( )
  A  正确
  B  错误


46
1、阻塞性赋值运算符为( )。
  A  =
  B  <=
  C  =>
  D  ==


47
转换精度和转换速度是衡量A/D、D/A转换器性能优劣的主要指标。( )
  A  正确
  B  错误


48
某电路如下图所示,输出逻辑表达式为( )。

  A   
  B   
  C   
  D   


49
下列表达式中不存在竞争冒险的是( )。
  A   
  B   
  C   
  D   


50
已知 ,则 = ( )。
  A   
  B   
  C   
  D   


51
图示电路实现的逻辑函数是( )。

  A   
  B   
  C   
  D   


52
对于门控D 锁存器来说,在( ),输出端Q 总是等于输入的数据D 。
  A  使能脉冲有效期间
  B  使能脉冲之前
  C  使能脉冲之后的瞬间
  D  任何时候


53
电路由TTL门电路组成，F的逻辑表达式是（   ）。

1.png
  A  
1.png

  B  
2.png

  C  
3.png

  D  
4.png



54
将二进制数 (1101.101)B 转换成八进制数是( )O 。
  A  15.5
  B  61.5
  C  13.25
  D  13.625


55
十进制数25用8421BCD码表示为( )。
  A  10 101
  B  0010 0101
  C  100101
  D  10101


56
下图电路的逻辑功能为（   ）

c.png
  A  
1.png

  B  
2.png

  C  
3.png

  D  
4.png



57
已知某触发器的状态转换图，此触发器的特性方程为（    ）
V.jpg
  A  
1.png

  B  
2.png

  C  
3.png

  D  
4.png



58
F=AB+CD 的真值表中,F=1 的状态有( )。
  A  7个
  B  4个
  C  8个
  D  2个


59
D/A转换器的位数越多,转换精度越高。( )
  A  正确
  B  错误


60
已知函数L(A,B,C,D)的卡诺图如图所示,则函数L的最简与-或表达式为( )。

  A   
  B   
  C   
  D   


61
图示SR锁存器为( )的SR锁存器。

  A  使能信号 低电平有效,输入信号S、R高电平有效
  B  使能信号 高电平有效,输入信号S、R高电平有效
  C  使能信号 低电平有效,输入信号S、R低电平有效
  D  使能信号 无效,输入信号S、R高电平有效


62
8线-3线优先编码器74LS148的优先编码顺序是 ,输出为 。输入输出均为低电平有效。当输入 为11010101时,输出 为( )。
  A  010
  B  101
  C  111
  D  000


63
一个n 位A/D转换器的分辨率可以表示为( )。
  A  n
  B  n-1
  C  1/n
  D   


64
有一组代码需暂时存放,应选用( )。
  A  计数器
  B  编码器
  C  触发器
  D  寄存器


65
用3/8译码器74HC138构成的电路如图所示,电路的逻辑功能是( )。

  A  判偶电路
  B  判一致电路
  C  多数表决器
  D  代码转换电路


66
标准与或式是由( )构成的逻辑表达式。
  A  最小项相或
  B  与项相或
  C  最大项相与
  D  或项相与


67
某同步时序电路的状态转换图如右,该时序电路是:( )

  A  同步四进制计数器
  B  同步六进制计数器
  C  同步八进制计数器
  D  同步五进制计数器


68
对于异或门下列等式错误的是( )。
  A   
  B   
  C   
  D   


69
如果规定只能使用非门和2输入与非门来实现 L=AB+AC,则正确的逻辑图是( )。
  A   
  B   
  C   
  D   


70
256×1位ROM地址线有( )条。
  A  8
  B  16
  C  32
  D  10


二.填空题（共1题,1.0分）

1
设主从JK触发器的初始状态为0,CP、J、K信号如图所示,其正确的触发器Q端的波形____。
B
A
D
C
第一空：





































三.判断题（共28题,28.0分）

1
实现两个一位二进制数和来自低位的进位相加的电路叫全加器?


2
在A/D 转换过程中,必然会出现量化误差?


3
利用施密特触发器对信号进行整形时,整形前和整形后信号的周期相同?


4
实现多输出组合逻辑电路时,通过共享相同乘积项,可以减少逻辑门数目?


5
若两个函数具有相同的真值表,则这两个逻辑函数必然相等?


6
数字电路中最基本的运算电路是减法器?


7
功耗是门电路重要参数之一。功耗有静态和动态之分。所谓静态功耗是指电路输出没有状态转换时的功耗。而电路在输出发生状态转换时的功耗称为动态功耗?


8
数字电路可分为组合逻辑电路和时序逻辑电路?


9
逻辑代数里的变量取值只有0、1两种?


10
用卡诺图化简逻辑函数,得到的最简与或式可能不是唯一的?


11
在TTL门电路中,输入端悬空、开路和接高平逻辑等效?


12
逻辑函数欲用与非门实现时,应变换成与非与非表达式;逻辑函数欲用或非门实现时,应变换成或非或非表达式?


13
EDA技术使硬件设计软件化?


14
传输延迟时间是表征门电路开关速度的参数,它说明门电路在输入脉冲波形的作用下,其输出波形相对于输入波形延迟了多长时间,其数值与电源电压VDD及负载电容的大小有关?


15
典型集成计数器74HC390是模可变的计数器?


16
对同一逻辑电路,无论采用正逻辑体制还是采用负逻辑体制,其逻辑功能都是一样的?


17
当2个或2个以上的输入同时为有效信号时,优先编码器将只对优先级别高的输入信号进行编码?


18
下图所示D 锁存器,只有当使能端E =1时,输入端D 的值才会影响到Q 的状态?



19
分析同步时序电路是为了确定在时钟CP控制下,电路输出信号和状态转换的规律?


20
MOS型集成逻辑门有CMOS、NMOS、PMOS,双极型集成逻辑门主要有TTL和ECL,混合型集成逻辑门有BiCMOS?


21
D/A转换过程中的非线性误差是可以消除的?


22
当A=D时,为D触发器的状态图?


23
T触发器的下一状态与T输入信号保持一致?


24
在Verilog HDL程序中,如果没有说明输入、输出变量的数据类型,则默认是wire型变量?


25
由与非门构成的基本SR锁存器如图所示,在 ,将使锁存器进入置位状态?



26
二值数字逻辑0、逻辑1只表示两种对立的逻辑状态,不表示数量的大小?


27
TTL 逻辑门电路是采用双极型三极管作为开关元件的数字集成电路?


28
CPLD是一种可编程的大规模集成电路?


四.简答题（共1题,1.0分）

1
已知74LS04的参数为:
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